1樓：匿名使用者
建議用protel的dxp版本到處orcad的網表，然後再封裝名前面加！，然後載入。處理封裝的那兩個路徑外，同時還要設定device路徑的，就是devpath路徑。
祝你好運。
2樓：匿名使用者
setup/ user preference，彈出的對話方塊中選擇paths/ library，庫路徑需設定padpath、parapath、p**path三個，ok之後重啟軟體
3樓：
好像你的*** list檔案就有問題吧，你說從protel生成的？網路表是要從schematic的軟體生成的啊，再說了即使是allegro的網路表也應該有它的格式（3個.dat檔案）。
你可以用的entry cis 產生一個網路表匯入試試。網路表對了其實就是路徑的設定：
padpath、
parapath、
p**path
devicepath
焊盤，封裝都應該放在該路徑下面，就ok了。
在cadence的allegro中畫了一個pcb的封裝，但在匯入網表生成pcb時引腳一發生的偏移，求各位大神解釋下 100
4樓：匿名使用者
你看看copy
你的那個引腳的pad，在bai
建立的時候是不是加了偏移，offset
或者是因為你du的那zhi個焊盤是由shape 做的，而你做shape的時候dao零點沒在中心，而在那個角上。然後你做成pad呼叫，再調入pcb中就偏移了
5樓：李金宮
這個copy很簡單，可肯定是你在建封裝時發生偏移了，1、你開啟part develpor看裡面的預覽是不是已經偏移了。2、確認library裡面沒有偏移，在pcb editer裡面tools 下refresh一下，或者在在place裡面update symbols一下你的封裝。3、如果還是偏移，重新開啟你的封裝檢視。
4、確認封裝建立正確但是就是偏移，那麼很有可能在你的physical資料夾下有一個和你的封裝名字一摸一樣的封裝檔案，刪掉後再refresh就可以了。
6樓：一座小宇宙
對的，第一個回答抄
是正解。主襲要是焊盤的bai
問題，你重做一下du焊盤試試zhi，在製作的過程中始dao終要注意焊盤的中心點儘量放在圖紙的中心點，否則還會有很多莫名其妙的問題，以前我第一次畫的時候就是因為這個，元器件不能正常擺放
7樓：手機使用者
先找到晶片的
bai各種參du數，如晶片引腳間距等，最zhi好是看晶片的datasheet再根dao據規則在pad designer裡面做版焊盤
權（如果庫裡面有，可以不做），做好焊盤後，在pcb editor裡面做器件的封裝。然後就ok了。
allegro如何避免匯入網表後器件佈局更改
8樓：匿名使用者
零件序號都來變了的網源絡表，匯入allegro當然會改變布bai局，這沒有好辦法，要麼原du
理圖手工把序號zhi改回dao來，要麼在allegro中將原來的佈局做一個模板（.mdd）,匯入新的網路表後選擇相關元件，按照佈局模板擺放，比較快!
希望能幫助到你，希望被採納！
怎樣將網路表匯入pcb？謝謝
9樓：西門不敗
pcb介面 在design 選單 load ***s
10樓：匿名使用者
要是樓主的原理圖沒錯可以直接匯入到pcb裡，由飛線連線著的
11樓：匿名使用者
你用的是什麼畫圖軟體，protel99？pads？allegro？
只有allegro pcb圖紙，無原理圖無網表，怎麼進行eco,去修改pcb的一個封裝或者說更換一個新的封裝替代舊？
在cadence的pcb editor中匯入網表時出現如下問題，高手哥或姐幫忙解答一下吧！
12樓：
如你所說的哦，確實有非法的字元 ，看你的design name ：「測試版副」，在設計中不能有中文出現否則會報錯執行下去的。
allegro pcb中匯入網表後，在畫pcb時沒有將所有元器件都加進去，有幾個我不想加了，這樣會有影響嗎？謝謝
13樓：匿名使用者
對你畫pcb沒有影響就行的，但是在後面drc檢查時，肯定會提示你有錯誤存在的。
最好的方法還是修改原理圖，再重新生成網表匯入pcb。
怎麼檢視allegro庫自帶的pcb封裝焊盤的屬性
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8.1好像沒有兩個選項,但是你新建工程時建立原理圖和pcb的話,畫好原理圖後pcb裡邊就直接有元件了,不用再進行匯入 list proteus ares怎樣使用 如果做pcb的話,bai先在 isis中畫出原理du圖,zhi 地線可以暫不加。然後dao再在回tools裡面找到 list to are...
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